东芝利用Synopsys布局设计工具将90nm工艺SoC运行速度提高10％--技术在线!

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东芝利用Synopsys布局设计工具将90nm工艺SoC运行速度提高10％

DATE	2005/06/10

　　【日经BP社报道】美国Synopsys公司日前宣布，东芝SoC研究开发中心已决定采用该公司的自动布局设计工具“IC Compiler”（发布资料）。东芝计划今后在包括MeP（媒体嵌入处理器）在内的90nm工艺SoC（系统级芯片）开发中使用IC Compiler。

　　IC Compiler是一款希望通过一次性完成物理合成、布线设计和时钟树合成，提高设计匹配性的EDA工具。据称，东芝在导入过程中，使用由90nm工艺半导体技术生产的时钟频率为400MHz的逻辑芯片，对该工具的性能进行了测试。结果，时钟频率提高10％，设计时间也缩短了。据东芝称，轻松完成了将IC Compiler移植到该公司现有设计流程的工作。（记者：大石基之）

■日文原文
東芝，Synopsysのレイアウト設計ツールで90nm世代のSoCを10％高速化

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